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디지털전자회로정보통신산업기사 · 2004년09월05일 · 17/80

17.D 플립-플롭을 이용하여 그림과 같은 회로를 구성하고, 클럭(clk)단자에 5[kHz] 클럭펄스를 인가하였다. 동작시작단계에서 Q 출력을 +5[V]로 하였다면 출력은?(정답률:알수없음)

정보통신산업기사 17번 문제 이미지

1

10[kHz]

2

2.5[kHz]

3

5[kHz]

4

5[V] DC정답

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